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/* Display controller SS */
/* DC part1 */
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#define IMX8QXP_DC0_PRG4_RTRAM_CLK 258
#define IMX8QXP_DC0_PRG4_APB_CLK 259
#define IMX8QXP_DC0_PRG5_RTRAM_CLK 260
#define IMX8QXP_DC0_PRG5_APB_CLK 261
#define IMX8QXP_DC0_PRG6_RTRAM_CLK 262
#define IMX8QXP_DC0_PRG6_APB_CLK 263
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#define IMX8QXP_DC0_PRG8_RTRAM_CLK 266
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#define IMX8QXP_DC0_DPR0_B_CLK 269
#define IMX8QXP_DC0_RTRAM0_CLK 270
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/* MIPI-LVDS part1 */
#define IMX8QXP_MIPI_IPG_CLK 272
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#define IMX8QXP_MIPI0_I2C1_IPG_CLK 280
#define IMX8QXP_MIPI0_PWM_IPG_S_CLK 281
#define IMX8QXP_MIPI0_PWM_IPG_CLK 282
#define IMX8QXP_MIPI0_PWM_32K_CLK 283
#define IMX8QXP_MIPI0_GPIO_IPG_CLK 284
#define IMX8QXP_IMG_JPEG_ENC_IPG_CLK 285
#define IMX8QXP_IMG_JPEG_ENC_CLK 286
#define IMX8QXP_IMG_JPEG_DEC_IPG_CLK 287
#define IMX8QXP_IMG_JPEG_DEC_CLK 288
#define IMX8QXP_IMG_PXL_LINK_DC0_CLK 289
#define IMX8QXP_IMG_PXL_LINK_DC1_CLK 290
#define IMX8QXP_IMG_PXL_LINK_CSI0_CLK 291
#define IMX8QXP_IMG_PXL_LINK_CSI1_CLK 292
#define IMX8QXP_IMG_PXL_LINK_HDMI_IN_CLK 293
#define IMX8QXP_IMG_PDMA_0_CLK 294
#define IMX8QXP_IMG_PDMA_1_CLK 295
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#define IMX8QXP_IMG_PDMA_3_CLK 297
#define IMX8QXP_IMG_PDMA_4_CLK 298
#define IMX8QXP_IMG_PDMA_5_CLK 299
#define IMX8QXP_IMG_PDMA_6_CLK 300
#define IMX8QXP_IMG_PDMA_7_CLK 301
#define IMX8QXP_IMG_AXI_CLK 302
#define IMX8QXP_IMG_IPG_CLK 303
#define IMX8QXP_IMG_PXL_CLK 304
#define IMX8QXP_CSI0_I2C0_DIV 305
#define IMX8QXP_CSI0_PWM0_DIV 306
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#define IMX8QXP_CSI0_ESC_DIV 308
#define IMX8QXP_CSI0_IPG_CLK_S 309
#define IMX8QXP_CSI0_IPG_CLK 310
#define IMX8QXP_CSI0_APB_CLK 311
#define IMX8QXP_CSI0_I2C0_IPG_CLK 312
#define IMX8QXP_CSI0_I2C0_CLK 313
#define IMX8QXP_CSI0_PWM0_IPG_CLK 314
#define IMX8QXP_CSI0_PWM0_CLK 315
#define IMX8QXP_CSI0_CORE_CLK 316
#define IMX8QXP_CSI0_ESC_CLK 317
#define IMX8QXP_HSIO_AXI_CLK 318
#define IMX8QXP_HSIO_PER_CLK 319
#define IMX8QXP_HSIO_PCIE_MSTR_AXI_CLK 320
#define IMX8QXP_HSIO_PCIE_SLV_AXI_CLK 321
#define IMX8QXP_HSIO_PCIE_DBI_AXI_CLK 322
#define IMX8QXP_HSIO_PCIE_X1_PER_CLK 323
#define IMX8QXP_HSIO_PHY_X1_PER_CLK 324
#define IMX8QXP_HSIO_MISC_PER_CLK 325
#define IMX8QXP_HSIO_PHY_X1_APB_CLK 326
#define IMX8QXP_HSIO_GPIO_CLK 327
#define IMX8QXP_HSIO_PHY_X1_PCLK 328
#define IMX8QXP_A35_DIV 329
/* ACM */
#define IMX8QXP_EXT_AUD_MCLK0 330
#define IMX8QXP_EXT_AUD_MCLK1 331
#define IMX8QXP_ESAI0_RX_CLK 332
#define IMX8QXP_ESAI0_RX_HF_CLK 333
#define IMX8QXP_ESAI0_TX_CLK 334
#define IMX8QXP_ESAI0_TX_HF_CLK 335
#define IMX8QXP_SPDIF0_RX 336
#define IMX8QXP_SAI0_RX_BCLK 337
#define IMX8QXP_SAI0_TX_BCLK 338
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/* VPU clocks. */
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/* DC part3 */
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